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1，在菜單preferences下設(shè)定無源器件R,C,L的映射類型。

2，在LAYER STACK MANANGER里設(shè)定層厚和銅厚。

3，在DESIGN/DESIGN RULES/SIGNAL INTEGRITY設(shè)置需要的SI規(guī)則。

4，運(yùn)行TOOLS/SIGNAL INTEGRITY，在信號完整性界面中運(yùn)行import IBIS-FILE，并將分析用的芯片的IBIS模型文件導(dǎo)入。

5，最關(guān)鍵的一步，用文本編輯器編輯Design Explorer 99 

SE\Library\SignalIntegrity\User\u_parts.hrt,這個文件指定了PROTEL99SE所有可用的器件模型，ASCII碼格式，很容易看懂，在這里可以創(chuàng)建新的器件模型，并為新的器件的每個引腳指定在第4步導(dǎo)入的引腳宏模型，可以具體到每個引腳，并把器件名改為PCB里器件屬性的COMMENT（當(dāng)然你也可以改COMMENT），存盤。

以下是個簡單的器件的格式：

TI!SN74221N PQ[16] TYP["DIC"]

IN[1--3,9--11]("TTL_000_S0_in.mac"),

[6,7,14,15]

OUT[4,5,12,13]("TTL_000_S0_out.mac")

BI[6,7,14,15]

VCC[16]

GND[8]

6，返回protel99se的PCB界面，運(yùn)行Reports/SIGNAL INTEGRITY,如果報告里ICs with valid models一欄中識別出你前面編輯的相關(guān)的器件模型的型號，說明設(shè)置大功告成，你可以返回DESIGN/DESIGN RULES/SIGNAL INTEGRITY中詳細(xì)設(shè)置信號完整性規(guī)則，并用tools/design rules check來檢查，同樣，在運(yùn)行TOOLS/SIGNAL INTEGRITY后的信號完整性界面中也不需要逐個設(shè)置信號的引腳模型，它已經(jīng)根據(jù)u_parts.hrt文件里的設(shè)置自動識別出來，可以直接選取信號做分析。

優(yōu)點(diǎn)：緩沖模型可以具體到引腳，批量信號分析結(jié)果比用默認(rèn)模型精確得多；可以做到反射分析中過沖和下沖的批量準(zhǔn)確分析，在信號完整性界面中還可以做比較準(zhǔn)確的單個串?dāng)_分析和付立葉展開的頻域分析，它可以確定信號中有害的EMI諧波分量。

缺點(diǎn)：對排阻的模型還是無法識別，當(dāng)有排阻無源器件時仿真會無法進(jìn)行。由于對延遲時間的計算方法不了解，目前對時序方面的約束目前無法實現(xiàn)。

本文由于時間關(guān)系，只說明了操作步驟，應(yīng)用者需要具備對protel99se比較深的操作能力和信號完整性理論基礎(chǔ)以及對現(xiàn)代EDA軟件的約束驅(qū)動設(shè)計方法有一定的了解。至于自己為什么會考慮protel99se來做信號完整性分析，是因為公司的原因，公司本來想上cadence，但自從我來到就職公司后，憑經(jīng)驗做的板子還都過得去，目前還沒有什么非得改變設(shè)計工具的問題，公司為了照顧其他人對cadence不熟，所以不再考慮，雖然我知道到要求高時不用cadence可能沒底，屢次要求更換設(shè)計工具沒有結(jié)果，便只好在protel99se上打主意，這便是本文的由來。